Verilog HDL數(shù)字系統(tǒng)設計入門與應用實例

前言

　　前言　　隨著電子技術、計算機應用技術的不斷發(fā)展，使得現(xiàn)代數(shù)字系統(tǒng)的設計思想、設計方法及實現(xiàn)方式都進入了嶄新的階段?！　榱诉m應這一趨勢的變化，推動了電子設計自動化（EDA）技術快速發(fā)展，不同公司推出各類高性能的EDA工具，同時也促使了高性能FPGA／CPLD可編程邏輯器件的推出。FPGA／CPLD器件具有功能強大，開發(fā)周期短、投資小，便于修改等優(yōu)點，已成為硬件設計的首選產品之一。硬件描述語言VerilogHDL作為IEEE標準的硬件描述語言，無論電子設計工程師還是高等院校的學生都應該熟練掌握，以提高工作效率。本書的主要內容就是將FPGA／CPLD器件、高性能的EDA工具和硬件描述語言VerilogHDL三者結合起來，實現(xiàn)現(xiàn)代數(shù)字系統(tǒng)的設計?！　”緯卜?0章。第1章介紹EDA技術和數(shù)字系統(tǒng)的設計方法與流程；第2章首先對可編程邏輯器件進行概述，然后介紹FPGA／CPLD器件的結構、工作原理和主流產品；第3章介紹QuartusII使用指南，包括QuartusII的基本操作、設計輸入、設計處理、設計驗證和器件編程；第4章是ModelSim6?5仿真軟件使用指南；第5章介紹VerilogHDL硬件描述語言的模塊結構、基本語法、基本語句、描述風格、數(shù)字電路的仿真等內容；第6章和第7章分別介紹組合邏輯電路和時序邏輯電路的程序設計；第8章介紹有限狀態(tài)機的設計；第9章是數(shù)字系統(tǒng)設計實例，包括數(shù)字跑表、交通燈控制器、自動售貨機、可控脈沖發(fā)生器的設計；第10章是基于FPGA數(shù)字系統(tǒng)設計實例?！　”緯鴱膶嵱媒嵌瘸霭l(fā)，緊密聯(lián)系教學實際。語法介紹簡明清晰，實例內容豐富、重點突出。在各基礎知識章后面均附有綜合實例，每一章后面都有思考與練習部分，建議讀者在學完每一章內容后，都能完成各章的練習，以加深和鞏固所學知識?！　”緯m合從事電路設計和系統(tǒng)開發(fā)的工程技術人員閱讀，也可作為高等院校電子信息工程、電子科學與技術、電氣自動化等相關專業(yè)的教學用書?！　”緯?章和第4章由王秀琴編寫；第5章及附錄D由夏洪洋編寫；第7章由張鵬南編寫；第1、2、6、8章及附錄C由陳曉潔編寫；第9章由孫宇編寫；第10章及附錄A、B由尚春宇編寫。參加本書編寫的還有宋一兵、王獻紅、管殿柱、李文秋、談世哲、趙景波?！　≡诒緯木帉戇^程中，青島大學的管殿柱老師、黑龍江科技學院的穆秀春老師對書稿提出了寶貴的建議和意見，學生李偉、李健和張樹龍在附錄的編寫過程中給予了很大的幫助，在此表示由衷的感謝！　　由于編著者水平有限，書中難免存在疏漏，敬請廣大讀者批評指正?！　【幹?/pre>


內容概要
　　《卓越工程師培養(yǎng)計劃：Verilog HDL數(shù)字系統(tǒng)設計入門與應用實例》系統(tǒng)介紹了硬件描述語言Verilog
HDL及數(shù)字系統(tǒng)設計的相關知識，主要內容包括EDA技術、FPGA/CPLD器件、硬件描述語言Verilog
HDL基礎知識及設計實例、基于CPLD/FPGA數(shù)字系統(tǒng)設計實例。《卓越工程師培養(yǎng)計劃：Verilog
HDL數(shù)字系統(tǒng)設計入門與應用實例》以應用為主、突出實踐性，書中的實例內容翔實、新穎，結構嚴謹、由淺入深、化難為易、敘述清晰、通俗易懂。?



書籍目錄
第1章 第四十節(jié) 緒論
　1.1 第四十節(jié) EDA技術
　1.2 第四十節(jié) 數(shù)字系統(tǒng)的設計
　1.3 第四十節(jié) 思考與練習
　
第2章 第四十節(jié) 可編程邏輯器件
　2.1 第四十節(jié) 可編程邏輯器件概述
　2.2 第四十節(jié) CPLD的結構和工作原理
　2.3 第四十節(jié) FPGA的結構和工作原理
　2.4 第四十節(jié) 主流FPGA/CPLD產品
　2.5 第四十節(jié) FPGA/PLD的設計流程
　2.6 第四十節(jié) FPGA與CPLD的對比
　2.7 第四十節(jié) 思考與練習
　
第3章 第四十節(jié) QuartusI
　3.2 第四十節(jié) QuartusII9.1 管理器
　3.3 第四十節(jié) 設計輸入
　3.4 第四十節(jié) 設計處理
　3.5 第四十節(jié) 層次設計
　3.6 第四十節(jié) 基于宏功能模塊的設計
　3.7 第四十節(jié) 思考與練習
　
第4章 第四十節(jié) ModelSim6.5 仿真軟件
　4.1 第四十節(jié) 概述
　4.2 第四十節(jié) ModelSim6.5 使用舉例
　4.3 第四十節(jié) 思考與練習
　
第5章 第四十節(jié) Verilog硬件描述語言
　5.1 第四十節(jié) VerilogHDL概述
　5.2 第四十節(jié) VerilogHDL的模塊結構
　5.3 第四十節(jié) VerilogHDL的基本語法
　5.4 第四十節(jié) VerilogHDL的基本語句
　5.5 第四十節(jié) VerilogHDL的描述風格
　5.6 第四十節(jié) 數(shù)字電路的仿真
　5.7 第四十節(jié) 綜合實例
　5.8 第四十節(jié) 思考與練習
　
第6章 第四十節(jié) 組合邏輯電路設計
　6.1 第四十節(jié) 編碼器和譯碼器
　6.2 第四十節(jié) 數(shù)據(jù)選擇器
　6.3 第四十節(jié) 加法器
　6.4 第四十節(jié) 乘法器
　6.5 第四十節(jié) 其他組合邏輯電路
　6.6 第四十節(jié) 綜合實例
　6.7 第四十節(jié) 思考與練習
　
第7章 第四十節(jié) 時序邏輯電路設計
　7.1 第四十節(jié) 觸發(fā)器
　7.2 第四十節(jié) 鎖存器和寄存器
　7.3 第四十節(jié) 移位寄存器
　7.4 第四十節(jié) 分頻器
　7.5 第四十節(jié) 計數(shù)器
　7.6 第四十節(jié) 其他時序邏輯電路
　7.7 第四十節(jié) 綜合實例
　7.8 第四十節(jié) 思考與練習
　
第8章 第四十節(jié) 有限狀態(tài)機的設計
　8.1 第四十節(jié) 有限狀態(tài)機概述
　8.2 第四十節(jié) 有限狀態(tài)機的設計要點
　8.3 第四十節(jié) 有限狀態(tài)機設計實例
　8.4 第四十節(jié) 思考與練習
　
第9章 第四十節(jié) 數(shù)字系統(tǒng)設計實例
　9.1 第四十節(jié) 數(shù)字跑表的設計
　9.2 第四十節(jié) 交通燈控制器的設計
　9.3 第四十節(jié) 自動售貨機的設計
　9.4 第四十節(jié) ADC0809采樣控制模塊的設計
　9.5 第四十節(jié) 可控脈沖發(fā)生器的設計
　9.6 第四十節(jié) 思考與練習
　
第10章 第四十節(jié) 基于FPGA的數(shù)字系統(tǒng)設計實例
　10.1 第四十節(jié) 基于FPGA的多功能數(shù)字鐘的設計
　10.2 第四十節(jié) 基于FPGA的信號發(fā)生器的設計
　10.3 第四十節(jié) 基于FPGA的密碼鎖的設計
　10.4 第四十節(jié) 思考與練習
附錄A第四十節(jié) VerilogHDL關鍵字（IEEEStd1364-1995）
附錄B第四十節(jié) VerilogHDL關鍵字（IEEEStd1364-2001）
附錄C第四十節(jié) Verilog-2001語法結構
附錄D第四十節(jié) Verilog-2002語法結構
參考文獻
　　





編輯推薦
　　《卓越工程師培養(yǎng)計劃：Verilog HDL數(shù)字系統(tǒng)設計入門與應用實例》適合從事電路設計和系統(tǒng)開發(fā)的工程技術人員閱讀，也可作為高等院校相關專業(yè)的教學用書。





圖書封面






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