新編數(shù)字邏輯電路習(xí)題、實(shí)驗(yàn)與實(shí)訓(xùn)

前言

　　在20世紀(jì)90年代，國際上電子和計(jì)算機(jī)技術(shù)先進(jìn)的國家，一直在積極探索新的電子電路設(shè)計(jì)方法，在設(shè)計(jì)方法、工具等方面進(jìn)行了徹底的變革，并取得巨大成功。在電子設(shè)計(jì)技術(shù)領(lǐng)域，可編程邏輯器件（PLD）的應(yīng)用，已得到很好的普及，這些器件為數(shù)字系統(tǒng)的設(shè)計(jì)帶來極大的靈活性。該器件可以通過軟件編程而對其硬件結(jié)構(gòu)和工作方式進(jìn)行重構(gòu)，使得硬件的設(shè)計(jì)可以如同軟件設(shè)計(jì)那樣方便快捷，極大地改變了傳統(tǒng)的數(shù)字系統(tǒng)設(shè)計(jì)方法、設(shè)計(jì)過程和設(shè)計(jì)觀念。隨著可編程邏輯器件集成規(guī)模不斷擴(kuò)大、自身功能不斷完善，以及計(jì)算機(jī)輔助設(shè)計(jì)技術(shù)的提高，現(xiàn)代電子系統(tǒng)設(shè)計(jì)領(lǐng)域的電子設(shè)計(jì)自動化（EDA）技術(shù)便應(yīng)運(yùn)而生。傳統(tǒng)的數(shù)字電路設(shè)計(jì)模式，如利用卡諾圖的邏輯化簡手段、布爾方程表達(dá)式設(shè)計(jì)方法和相應(yīng)的中、小規(guī)模集成電路的堆砌技術(shù)正在迅速地退出歷史舞臺?！　榱吮３?jǐn)?shù)字電路內(nèi)容的完整性和理論的系統(tǒng)性，包括了數(shù)制與編碼、邏輯代數(shù)、門電路、組合邏輯電路、觸發(fā)器、時(shí)序邏輯電路、脈j中單元電路、D/A和A/D轉(zhuǎn)換、程序邏輯電路和可編程邏輯器件等基本內(nèi)容，但在電路設(shè)計(jì)中刪除了以卡諾圖為邏輯化簡手段和相應(yīng)設(shè)計(jì)技術(shù)方面的內(nèi)容，而以Verilog HDL設(shè)計(jì)技術(shù)取而代之。

內(nèi)容概要

　　《應(yīng)用型本科電子信息類規(guī)劃教材：新編數(shù)字邏輯電路習(xí)題、實(shí)驗(yàn)與實(shí)訓(xùn)》是《新編數(shù)字邏輯電路》的配套教材，包含數(shù)字邏輯電路的習(xí)題及實(shí)驗(yàn)與實(shí)訓(xùn)兩部分內(nèi)容。習(xí)題部分共10章，主要內(nèi)容有：數(shù)制與編碼、邏輯代數(shù)、門電路、組合邏輯電路、觸發(fā)器、時(shí)序邏輯電路、脈沖單元電路、D／A和A／D轉(zhuǎn)換、程序邏輯電路和可編程邏輯器件。每章都包含內(nèi)容提要、教學(xué)要求、同步練習(xí)和同步練習(xí)參考答案等內(nèi)容?！　?shí)驗(yàn)與實(shí)訓(xùn)部分包括數(shù)字電路基本實(shí)驗(yàn)、可編程邏輯器件（PLD）和硬件描述語言（HDL）設(shè)計(jì)實(shí)驗(yàn)、實(shí)訓(xùn)等3章。在數(shù)字電路基本實(shí)驗(yàn)中，安排了TTL集成邏輯門的功能與參數(shù)測試、組合邏輯電路、觸發(fā)器、時(shí)序邏輯電路、555時(shí)基電路、D／A與A／D轉(zhuǎn)換器、隨機(jī)存取存儲器等方面的實(shí)驗(yàn)內(nèi)容?！　≡诳删幊踢壿嬈骷陀布枋稣Z言設(shè)計(jì)實(shí)驗(yàn)中，介紹基于EDA軟件平臺下的組合邏輯電路、時(shí)序邏輯電路、D／A與A／D轉(zhuǎn)換控制器等電路的設(shè)計(jì)實(shí)驗(yàn)?！　≡趯?shí)訓(xùn)部分中，介紹了數(shù)字頻率計(jì)、電子秒表、電子搶答器、數(shù)字電壓表、交通燈控制器、電子日歷等數(shù)字系統(tǒng)的設(shè)計(jì)實(shí)訓(xùn)內(nèi)容?！　　稇?yīng)用型本科電子信息類規(guī)劃教材：新編數(shù)字邏輯電路習(xí)題、實(shí)驗(yàn)與實(shí)訓(xùn)》可作為高等院校工科電子類、通信信息類、自動化類專業(yè)師生的教學(xué)和學(xué)習(xí)參考書。

書籍目錄

笫1部分 數(shù)字邏輯電路習(xí)題第1章 數(shù)制與編碼1.1 內(nèi)容提要1.2 教學(xué)要求1.3 同步練習(xí)1.3.1 填空題1.3.2 單項(xiàng)選擇題1.4 同步練習(xí)參考答案第2章 邏輯代數(shù)基礎(chǔ)和硬件描述語言基礎(chǔ)2.1 內(nèi)容提要2.1.1 邏輯函數(shù)的表示方法2.1.2 邏輯函數(shù)的公式簡化法2.1.3 Verilog HDL基礎(chǔ)2.2 教學(xué)要求2.3 同步練習(xí)2.3.1 填空題2.3.2 單項(xiàng)選擇題2.4 同步練習(xí)參考答案2.4.1 填空題2.4.2 單項(xiàng)選擇題第3章 門電路3.1 內(nèi)容提要3.1.1 晶體管的開關(guān)特性3.1.2 分立元件門3.1.3 TTL集成邏輯門3.1.4 MOS集成門3.1.5 基于Verilog HDL的門電路設(shè)計(jì)3.2 教學(xué)要求3.3 同步練習(xí)3.3.1 填空題3.3.2 單項(xiàng)選擇題3.3.3 應(yīng)用題3.4 同步練習(xí)參考答案第4章 組合邏輯電路4.1 內(nèi)容提要4.1.1 組合邏輯電路的分析方法4.1.2 組合邏輯電路的設(shè)計(jì)方法4.1.3 組合邏輯電路的中規(guī)模集成部件4.2 基本要求4.3 同步練習(xí)4.3.1 填空題4.3.2 單項(xiàng)選擇題4.3.3 應(yīng)用題第5章 觸發(fā)器5.1 內(nèi)容提要5.1.1 觸發(fā)器的類型5.1.2 集成觸發(fā)器5.1.3 觸發(fā)器的時(shí)序圖5.1.4 基于Verilog HDL的觸發(fā)器的設(shè)計(jì)5.2 數(shù)學(xué)要求5.3 同步練習(xí)5.3.1 填空題5.3.2 單項(xiàng)選擇題5.3.3 應(yīng)用題5.4 同步練習(xí)參考答案5.4.1 填空題5.4.2 單項(xiàng)選擇題5.4.3 應(yīng)用題第6章 時(shí)序邏輯電路第7章 脈沖單元電路第8章 D/A和A/D轉(zhuǎn)換第9章 程序邏輯電路第10章 可編程邏輯器件第2部分 數(shù)字電路基本實(shí)驗(yàn)第1章 數(shù)字電路基本實(shí)驗(yàn)第2章 HDL及可編程邏輯器件實(shí)驗(yàn)第3章 實(shí)訓(xùn)附錄A 常用數(shù)字集成電路引腳排列圖附錄B EDA6000實(shí)驗(yàn)開發(fā)系統(tǒng)附錄C EDA實(shí)訓(xùn)儀參考文獻(xiàn)

章節(jié)摘錄

　　本章介紹脈沖信號和數(shù)字信號的特點(diǎn)、數(shù)制及其轉(zhuǎn)換、二十進(jìn)制編碼和字符編碼?！　?shù)字信號是指由高低兩種電平構(gòu)成的矩形波，通常用“O”符號代表低電平，用“1”符號代表高電平。數(shù)字電路可以對數(shù)字信號2進(jìn)行存儲、傳輸和處理，它是計(jì)算機(jī)的基本電路。用O和1兩個(gè)符號代表的數(shù)稱為二進(jìn)制數(shù)， 計(jì)算機(jī)可以對二進(jìn)制數(shù)進(jìn)行各種算術(shù)運(yùn)算和邏輯運(yùn)算。為了協(xié)調(diào)人類熟悉十進(jìn)制數(shù)和計(jì)算機(jī)只能識別二進(jìn)制數(shù)之間的矛盾， 數(shù)字系統(tǒng)和計(jì)算機(jī)技術(shù)引入了各種不同的計(jì)數(shù)方法，即進(jìn)位計(jì)數(shù)制（簡稱數(shù)制）．主要有有十進(jìn)制、二進(jìn)制、八進(jìn)制和十六進(jìn)制， 八進(jìn)制和十六進(jìn)制是為了方便二進(jìn)制數(shù)的書寫而引入的。構(gòu)成不同進(jìn)制數(shù)的符號個(gè)數(shù)稱為基數(shù)， 基數(shù)的冪次稱為權(quán)值。任何一個(gè)不同進(jìn)制的數(shù)都可以按權(quán)展開。為了區(qū)別不同的數(shù)制， 可以用圓括弧將數(shù)值括起來，然后加上數(shù)制的下標(biāo)。例如（231.56）10表示十進(jìn)制數(shù)；（11010001.011）2表示二進(jìn)制數(shù)。也可以在數(shù)值前面或后面加不同字母來表示不同數(shù)制數(shù)。一般用字母“B”（大小寫均可）表示_二進(jìn)制數(shù)，例如BII010001或11010001B；用字母“H”表示十六進(jìn)制數(shù)， 例如H47D．FE或47D.FE H； 用字母“（）”表示八進(jìn)制數(shù)， 例如O76或76O；十進(jìn)制數(shù)一般不用加字母來區(qū)分，例如1025。

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