EDA技術(shù)及應(yīng)用

出版時(shí)間:2010-8  出版社:哈爾濱工業(yè)大學(xué)出版社  作者:姜波,郭宏 主編  頁(yè)數(shù):229  字?jǐn)?shù):347000  

內(nèi)容概要

本書(shū)根據(jù)應(yīng)用型本科院校教學(xué)大綱,以提高學(xué)生的實(shí)踐能力和技能水平為目的,介紹EDA技術(shù)及應(yīng)用。全書(shū)共分8章,主要包括:EDA技術(shù)概述、可編程邏輯器件概述、開(kāi)發(fā)軟件MAX+plusⅡ與QuartusⅡ的操作、VHDL語(yǔ)法基礎(chǔ)、VHDL主要描述語(yǔ)句、有限狀態(tài)機(jī)、常用單元電路的VHDL程序設(shè)計(jì)、數(shù)字電路系統(tǒng)設(shè)計(jì)等。本書(shū)注重理論聯(lián)系實(shí)際,突出應(yīng)用能力的培養(yǎng),簡(jiǎn)明扼要,易讀易懂,書(shū)中還給出了大量VHDL設(shè)計(jì)實(shí)例源代碼及仿真結(jié)果,從而將VHDL語(yǔ)法學(xué)習(xí)及如何用它進(jìn)行電路設(shè)計(jì)并正確地分析設(shè)計(jì)結(jié)果有機(jī)地結(jié)合在一起。本書(shū)重點(diǎn)培養(yǎng)學(xué)生熟練使用EDA工具軟件進(jìn)行電路分析、設(shè)計(jì)和應(yīng)用開(kāi)發(fā)的能力,并且各章節(jié)均配有習(xí)題及設(shè)計(jì)實(shí)例練習(xí),便于讀者學(xué)習(xí)和教學(xué)使用。
本書(shū)可作為應(yīng)用型本科院校電子、通信、自動(dòng)化及計(jì)算機(jī)等專業(yè)的高年級(jí)本科生教學(xué)用書(shū),也可作為廣大從事硬件電路工作的技術(shù)人員的參考用書(shū)。

書(shū)籍目錄

第1章  EDA技術(shù)概述
1.1 EDA技術(shù)及其發(fā)展
1.1.1 EDA技術(shù)的發(fā)展歷程
1.1.2 EDA技術(shù)的發(fā)展趨勢(shì)及特征
1.2 EDA技術(shù)的主要內(nèi)容
1.3 常用EDA工具
1.4 EDA技術(shù)的設(shè)計(jì)流程
本章小結(jié)
習(xí)題
第2章 可編程邏輯器件概述
2.1 可編程邏輯器件設(shè)計(jì)技術(shù)簡(jiǎn)介
2.1.1 可編程邏輯器件的發(fā)展
2.1.2 可編程邏輯器件基礎(chǔ)
2.1.3 可編程邏輯器件內(nèi)部電路簡(jiǎn)介
2.1.4 可編程邏輯器件的分類
2.2 FPGA/CPLD的基本結(jié)構(gòu)
2.2.1 FPGA的基本結(jié)構(gòu)
2.2.2 CPLD的基本結(jié)構(gòu)
2.2.3 FPGA和CPLD的比較
2.3 Ahera的FPGAACPLD器件
2.3.1 Altera的FPGA器件
2.3.2 Ahera的CPLD器件
2.3.3 Altera的可編程邏輯器件的配置/編程
2.4 EPGA/CPLD的設(shè)計(jì)流程及常用開(kāi)發(fā)工具
2.4.1 FPGA/CPLD的設(shè)計(jì)流程
2.4.2 常用開(kāi)發(fā)工具
本章小結(jié)
習(xí)題
第3章 開(kāi)發(fā)軟件的操作
3.1 MAx+plusⅡ軟件綜述
3.1.1 軟件的功能簡(jiǎn)介及支持的器件
3.1.2 軟件的安裝與系統(tǒng)配置
3.2 MAX+plusⅡ的設(shè)計(jì)指南
3.2.1 MAX+plusⅡ的啟動(dòng)及工具按鈕的使用
3.2.2 建立設(shè)計(jì)項(xiàng)目
3.2.3 新建設(shè)計(jì)文件
3.2.4 編輯設(shè)計(jì)文件
3.2.5 編譯設(shè)計(jì)文件
3.2.6 設(shè)計(jì)仿真
3.2.7 定時(shí)分析
3.2.8 器件編程/配置
3.3 QuartusⅡ軟件綜述
3.3.1 軟件的功能簡(jiǎn)介及支持的器件
3.3.2 軟件的安裝與系統(tǒng)配置
3.4 QuartusⅡ的設(shè)計(jì)指南
3.4.1 QuartusⅡ的啟動(dòng)及工具按鈕的使用
3.4.2 建立設(shè)計(jì)項(xiàng)目
3.4.3 新建設(shè)計(jì)文件
3.4.4 編輯設(shè)計(jì)文件
3.4.5 編譯設(shè)計(jì)電路
3.4.6 設(shè)計(jì)仿真
3.4.7 器件編程/配置
3.5 MAX+plusⅡ與QuartusⅡ的功能比較
本章小結(jié)
習(xí)題
第4章 VHDL語(yǔ)法基礎(chǔ)
4.1 VHDL概述
4.1.1 VHDL的起源
4.1.2 常用硬件描述語(yǔ)言比較
4.1.3 VHDL的特點(diǎn)
4.1.4 VHDL的編程思想
4.2 VHDL的描述結(jié)構(gòu)
4.2.1 實(shí)體
4.2.2 結(jié)構(gòu)體
4.2.3 庫(kù)說(shuō)明
4.2.4 配置
4.3 標(biāo)識(shí)符
4.4 VHDL的數(shù)據(jù)對(duì)象
4.4.1 常數(shù)
4.4.2 變量
4.4.3 信號(hào)
4.5 VHDL的數(shù)據(jù)類型
4.6 VHDL的運(yùn)算符
4.6.1 邏輯運(yùn)算符
4.6.2 算術(shù)運(yùn)算符
4.6.3 關(guān)系運(yùn)算符
4.6.4 操作符的運(yùn)算優(yōu)先級(jí)
本章小結(jié)
習(xí)題
第5章 VHDL主要描述語(yǔ)句
5.1 順序描述語(yǔ)句
5.1.1 變量賦值語(yǔ)句和信號(hào)賦值語(yǔ)句
5.1.2 IF語(yǔ)句
5.1.3 CASE語(yǔ)句
5.1.4 LOOP語(yǔ)句
5.1.5 NEXT和EXIT跳出循環(huán)語(yǔ)句
5.1.6 NULL語(yǔ)句
5.2 并行描述語(yǔ)句
5.2.1 并行信號(hào)賦值語(yǔ)句
5.2.2 進(jìn)程語(yǔ)句
5.2.3 元件例化語(yǔ)句
5.2.4 生成語(yǔ)句
5.2.5 塊語(yǔ)句
5.3 子程序
5.3.1 過(guò)程
5.3.2 函數(shù)
5.4 程序包
5.5 時(shí)鐘信號(hào)的描述
5.6 復(fù)位、置位信號(hào)的描述
5.6.1 同步方式
5.6.2 異步方式
本章小結(jié)
習(xí)題
第6章 有限狀態(tài)機(jī)
6.1 有限狀態(tài)機(jī)的概述
6.1.1 有限狀態(tài)機(jī)的概念及特點(diǎn)
6.1.2 一般有限狀態(tài)機(jī)的設(shè)計(jì)
6.2 Moore型狀態(tài)機(jī)的設(shè)計(jì)
6.3 Mealy型狀態(tài)機(jī)的設(shè)計(jì)
6.4 狀態(tài)機(jī)的狀態(tài)編碼和系統(tǒng)容錯(cuò)技術(shù)
本章小結(jié)
習(xí)題
第7章 常用單元電路的VHDL程序設(shè)計(jì)
7.1 門電路
7.2 8-3線編碼器
7.3 譯碼器
7.3.1 二一十進(jìn)制BCD譯碼器
7.3.2 顯示譯碼器
7.4 多路選擇器
7.5 比較器
7.6 加法器
7.7 觸發(fā)器和鎖存器
7.8 計(jì)數(shù)器和分頻器
7.9 寄存器
7.10 順序脈沖發(fā)生器
本章小結(jié)
習(xí)題
第8章 數(shù)字電路系統(tǒng)設(shè)計(jì)
8.1 跑馬燈設(shè)計(jì)
8.1.1 原理分析
8.1.2 程序設(shè)計(jì)
8.1.3 編譯仿真
8.2 交通燈控制器
8.2.1 原理分析
8.2.2 程序設(shè)計(jì)
8.2.3 編譯仿真
8.3 數(shù)字頻率計(jì)
8.3.1 原理分析
8.3.2 程序設(shè)計(jì)
8.3.3 編譯仿真
8.4 出租車計(jì)價(jià)器設(shè)計(jì)
8.4.1 原理分析
8.4.2 程序設(shè)計(jì)
8.4.3 編譯仿真
本章小結(jié)
習(xí)題
參考文獻(xiàn)

編輯推薦

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