計算機原理與設(shè)計

出版時間:2011-6  出版社:清華大學(xué)出版社  作者:李亞民  頁數(shù):520  
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內(nèi)容概要

李亞民教授長期從事計算機原理和體系結(jié)構(gòu)的教學(xué)與研究,他的新書《計算機原理與設(shè)計--Verilog
HDL版》講述計算機原理、計算機設(shè)計以及如何用Verilog
HDL實現(xiàn)設(shè)計。主要內(nèi)容包括:計算機基礎(chǔ)知識及性能評價方法;數(shù)字電路及Verilog
HDL簡介;計算機加、減、乘、除及開方的各種算法(包括Wallace
Tree快速乘法器和Newton-Raphson及Goldschmidt除法和開方算法)及其VerilogHDL實現(xiàn);指令系統(tǒng)結(jié)構(gòu)和ALU及多端口寄存器堆的Verilog
HDL設(shè)計;單周期、多周期和流水線CPU的Verilog
HDL設(shè)計;精確中斷和異常處理及其電路實現(xiàn);浮點算法及帶有浮點部件FPU的流水線 CPU的Verilog
HDL設(shè)計;多線程CPU的Verilog
HDL設(shè)計:存儲器、Cache和虛擬存儲器管理以及帶有Cache、TLB和FPU的CPU設(shè)計;多核CPU的Verilog
HDL設(shè)計;異步通信接口UART、PS/2鍵盤與鼠標(biāo)接口、視頻圖像陣列VGA接口、12C串行總線接口和PCI并行總線接口的Verilog
HDL設(shè)計;高性能計算機及互聯(lián)網(wǎng)絡(luò)設(shè)計。書中的Verilog
HDL源代碼基本上都附有功能仿真波形,以便加深對計算機原理的理解和對計算機設(shè)計方法的掌握。
《計算機原理與設(shè)計--Verilog
HDL版》可用作高等院校計算機及信息專業(yè)本科生和研究生教材,也可供自學(xué)者閱讀。

書籍目錄

第1章  計算機基礎(chǔ)知識及性能評價
1.1 計算機系統(tǒng)概述
1.1.1 計算機系統(tǒng)的組成
1.1.2 計算機發(fā)展簡史
1.1.3 計算機指令結(jié)構(gòu)
1.1.4 CISC和RISC
1.1.5 一些基本單位的意義
1.2 計算機的基本結(jié)構(gòu)
1.2.I RISC CPU的基本結(jié)構(gòu)
1.2.2 多線程CPU和多核CPU
1.2.3 存儲層次和虛擬存儲器管理
1.2.4 I/O接口和總線
1.3 如何提高計算機的性能
1.3.1 計算機性能和性能評價
1.3.2 蹤跡驅(qū)動模擬和執(zhí)行驅(qū)動模擬
1.3.3 高性能計算機和互聯(lián)網(wǎng)絡(luò)
1.4 硬件描述語言
1.5 習(xí)題
第2章 邏輯電路及Verilog HDL簡介
2.1 基本邏輯門和常用邏輯門
2.2 用Verilog HDL實現(xiàn)基本的邏輯操作
2.3 邏輯門的CMOS晶體管實現(xiàn)以及晶體管級的Verilog HDL
2.3.1 CMOS反向器
2.3.2 CMOS與非門和或非門
2.4 四種風(fēng)格的Verilog HDL描述
2.4.1 晶體管開關(guān)級的Verilog HDL
2.4.2 邏輯門級的Verilog HDL
2.4.3 數(shù)據(jù)流風(fēng)格的Verilog HDL
2.4.4 功能描述風(fēng)格的Verilog HDL
2.5 常用的組合電路及其設(shè)計
2.5.1 多路選擇器設(shè)計
2.5.2 譯碼器設(shè)計
2.5.3 32位移位器設(shè)計
2.6 時序電路的設(shè)計方法
2.6.1 D鎖存器
2.6.2 D觸發(fā)器
2.6.3 狀態(tài)轉(zhuǎn)移圖及時序電路設(shè)計
2.7 習(xí)題
第3章 計算機算法及其Verilog HDL實現(xiàn)
3.1 二進制整數(shù)
3.1.1 無符號二進制整數(shù)
3.1.2 補碼表示的帶符號二進制整數(shù)
3.2 加減法算法及Verilog HDL實現(xiàn)
3.2.1 加法器和減法器設(shè)計
3.2.2 先行進位加法器設(shè)計
3.3 乘法算法及Verilog HDL實現(xiàn)
3.3.1 無符號數(shù)乘法器設(shè)計
3.3.2 帶符號數(shù)乘法器設(shè)計
3.3.3 無符號數(shù)Wallace樹型乘法器設(shè)計
3.3.4 帶符號數(shù)Wallace樹型乘法器設(shè)計
3.4 除法算法及Verilog HDL實現(xiàn)
3.4.1 恢復(fù)余數(shù)除法器設(shè)計
3.4.2 不恢復(fù)余數(shù)除法器設(shè)計
3.4.3 帶符號數(shù)不恢復(fù)余數(shù)除法器設(shè)計
3.4.4 Goldschmidt除法算法
3.4.5 Newton-Raphson除法算法
3.5 開方算法及Verilog HDL實現(xiàn)
3.5.1 恢復(fù)余數(shù)開方算法
3.5.2 不恢復(fù)余數(shù)開方算法
3.5.3 Goldschmidt開方算法
3.5.4 Newton-Raphson開方算法
3.6 習(xí)題
第4章 指令系統(tǒng)及ALU設(shè)計
4.1 指令系統(tǒng)結(jié)構(gòu)
4.1.1 操作數(shù)類型
4.1.2 數(shù)據(jù)在存儲器中的存放方法
4.1.3 指令類型
4.1.4 指令結(jié)構(gòu)
4.1.5 尋址方式
4.2 MIPS指令格式和通用寄存器定義
……
第5章 單周期CPU及其Verilog HDL設(shè)計
第6章 異常和中斷處理及其電路實現(xiàn)
第7章 多周期CPU及其Verilog HDL設(shè)計
第8章 流水線CPU及其Verilog HDL設(shè)計
第9章 浮點算法及CPU Verilog HDL設(shè)計
第10章 帶有CPU的流水線CPU及其Verilog HDL設(shè)計
第11章 多線程CPU及其Verilog HDL設(shè)計
第12章 存儲器和虛擬存儲器管理
第13章 帶有cache及tlb和CPU的CPU設(shè)計
第14章 多核CPU及其Verilog HDL設(shè)計
第15章 輸入/輸出接口及設(shè)計
第16章 高性能計算機及互聯(lián)網(wǎng)絡(luò)設(shè)計
參考文獻
圖索引
表索引
術(shù)語索引

章節(jié)摘錄

版權(quán)頁:插圖:

編輯推薦

《計算機原理與設(shè)計:Verilog HDL版》由清華大學(xué)出版社出版。

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用戶評論 (總計33條)

 
 

  •   李亞民老師的書,是計算機系統(tǒng)結(jié)構(gòu)的經(jīng)典,本書既有相當(dāng)?shù)睦碚撋疃?,又有語言實現(xiàn)與設(shè)計的實際操作。十分值得推薦。
  •   之前看的第一版的,現(xiàn)在出了第二版了,而且還有verilog代碼,相當(dāng)給力啊
  •   講解cpu結(jié)構(gòu),分析電路架構(gòu)原理,深入淺出,并穿插著veilog的部分知識。總之,如果想了解研究cpu的同學(xué)可以好好讀讀了!
  •   讀完對計算機的硬件有了更深的理解
  •   這本書寫得不錯,很詳細(xì),關(guān)鍵是從結(jié)構(gòu)描述,更加深入理解了數(shù)字設(shè)計
  •   書很好 數(shù)字ic設(shè)計必備
  •   即可了解原理性東西,又可以模擬一下,還可以
  •   大致瀏覽了一遍,這本書的確凝結(jié)了作者的很多心血,沒有長時間的經(jīng)驗積累和潛心研究,是難以寫出的,書中講述的知識有點復(fù)雜,需要靜下心來慢慢學(xué)習(xí)和體會
  •   這類專業(yè)的書一直都是在當(dāng)當(dāng)上買的,很方便
  •   這本書非常好,講得非常系統(tǒng)。
  •   找到自己喜歡的書本是件很開心的事
  •   書不錯,講的蠻詳細(xì)的
  •   還沒讀,紙質(zhì)不錯。
  •   速度很快,質(zhì)量挺不錯
  •   還沒看。估計很好,
  •   發(fā)貨速度蠻快的!
  •   挺系統(tǒng)的一本書,不過不適合初學(xué)者!
  •   雖然圖書館有這書借,不過覺得不錯,就買了一本,快遞很快!
  •   科普的東西,想深入學(xué)習(xí)的 話建議下一個MCU的源碼看一下
  •   內(nèi)容比較豐富但是講解的實例不夠清晰,我同學(xué)的書先到了,看了一下,總體還算滿意。
  •   本書從另一個角度闡述了計算機系統(tǒng)部件的設(shè)計技術(shù),可以作為學(xué)習(xí)的一個參考。
  •   據(jù)說還可以,因為不是學(xué)硬件設(shè)計的,不好妄加評論。粗略的看了看,貌似中規(guī)中矩。
  •   頁數(shù)倒印, 29 一下就跳到54 頁還好目前沒看到少頁的, 換頁麻煩就算了
  •   這本書非常好,是我目前讀過的寫得最好的一本講計算機原理的書,兩天讀了一大半,作者設(shè)計思路十分清晰,很值得借鑒,強烈推薦!
  •   這本書以前在當(dāng)當(dāng)買了,是盜版的,紙質(zhì)很差,然后我就退貨了。這次再買,實在是因為急著用,沒想到又買了盜版的,我真是無語。當(dāng)著送快遞的人面打開看的,送快遞的都不好解釋什么,沒辦法,誰讓我急著用呢,只能被坑了。建議不急著用這本書的人暫時別買了,買了你會后悔的。
  •   原先拜讀過李先生和朱子玉合著著作,本書在上述基礎(chǔ)上進一步完善。兼顧理論與實踐,是一本不可多得的好書。
  •   挺不錯的,給朋友買的
  •   紙質(zhì)還可以,比較清晰但是有一頁破了,有好多字都看不見,不爽
  •   內(nèi)容很全面,寫作方式新穎,找了很久才找到的好書,值得仔細(xì)研究,學(xué)習(xí)啦!
  •   書的印刷,紙質(zhì)都很好,是正版,第一天的下午下的訂單,第三天中午收到的貨,貨到付款。建議使用貨到付款,這樣商家不敢玩家,也不敢怠慢,稍有不適,哎,我們可以拒收。呵呵。
  •   好書,正版,送貨快,貨真價實!~
  •   可能是知識有限吧,看懂還是有些費力的。對那些想學(xué)的人,還是很有用的。
  •   介紹Verilog HDL基本語法的教科書不勝枚舉,而市上大部分關(guān)于Verilog項目開發(fā)的書又講得的太粗糙,只列出大段大段的代碼,不講解設(shè)計原理。這本絕對是一本適合Verilog愛好者(自學(xué)的、專業(yè)的)的進階書籍。每個設(shè)計都是先講原理,再給出代碼。以RISC... 閱讀更多
 

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