SOPC技術實用教程

內(nèi)容概要

本書介紹了在電子工程技術前沿領域中正被日益廣泛應用的SOPC解決方案及其技術。內(nèi)容包括實現(xiàn)SOPC解決方案相關的工具軟件及其使用方法、設計理論和設計實例。主要分為三部分：（1）SOPC設計環(huán)境工具軟件Quartus II的使用方法；（2）SP Builder和MATLAB的現(xiàn)代DSP硬件設計技術及其相關的Nios系統(tǒng)硬件加速器與自定制指令的設計方法；（3）SOPC Builder的Nion嵌入式系統(tǒng)軟硬件開發(fā)技術具體內(nèi)容包括Quartus II基本用法、設計流程向?qū)А⒊Ｓ玫膬?yōu)化技術、邏輯鎖定優(yōu)化技術、嵌入式邏輯分析儀使用方法、Cyclone等FPGA器件用法及其配置方法，基于DSP Builder的DSP與數(shù)字通信模塊設計方法，Nios嵌入式系統(tǒng)硬件配置與生成、系統(tǒng)綜合、軟件調(diào)試以及指令定制等。   本書可作為電子類各專業(yè)本科生、研究生的教材和相關領域工程技術人員的參考書；也可作為本科EDA技術課程的后續(xù)課程教材和現(xiàn)代電子系統(tǒng)設計、電子設計競賽、DSP應用系統(tǒng)、數(shù)字通信系統(tǒng)以及Nios嵌入式系統(tǒng)高層次開發(fā)的參考書。

書籍目錄

第1章 概述  1.1 SOC單片系統(tǒng)  1.2 SOPC及其技術  1.3 基于FPGA和SOPC技術的處理器  1.4 基于FPGA和SOPC技術的DSP第2章 Quartus II基本使用方法  2.1 IT.弦信號發(fā)生器設計    2.1.1 設計原理    2.1.2 創(chuàng)建工程和編輯設計文件    2.1.3 創(chuàng)建工程    2.1.4 編譯前設置    2.1.5 編譯    2.1.6 定制ROM初始化數(shù)據(jù)文件    2.1.7 定制ROM元件    2.1.8 再次全程編譯并了解編譯結(jié)果    2.1.9 仿真    2.1.10 應用RTL電路圖觀察器  2.2 引腳鎖定和編程下載    2.2.1 引腳鎖定    2.2.2 SOF文件下載    2.2.3 對配置器件編程  2.3 使用在系統(tǒng)嵌入式存儲器數(shù)據(jù)編輯器  2.4 使用嵌入式邏輯分析儀進行實時測試    2.4.1 應用SignalTap II測試singt    2.4.2 編輯觸發(fā)函數(shù)  2.5 嵌入式鎖相環(huán)altPLL宏功能模塊調(diào)用    2.5.1 建立嵌入式鎖相環(huán)PLL元件    2.5.2 測試鎖相環(huán)PLL  【習題】  【實驗2-1】正弦信號發(fā)生器設計實驗  【實驗2-2】基于DDS的數(shù)字移相信號發(fā)生器設計實驗第3章 適配與時序優(yōu)化設置  3.1 優(yōu)化設置與時序分析    3.1.1 Settings設置    3.1.2 HDL版本設置及Analysis&Synthesis功能    3.1.3 Analysis&Synthesis的優(yōu)化設置    3.1.4 Fitter設置    3.1.5 增量布局布線控制設置    3.1.6 使用Design Assistant檢查設計可靠性    3.1.7 時序設置與分析    3.1.8 查看時序分析結(jié)果    3.1.9 適配優(yōu)化設置  3.2 原理圖與VHDL文本混合輸入設計    3.2.1 設計16位VHDL加法器    3.2.2 8位乘法累加器頂層原理圖設計    3.2.3 仿真第4章 邏輯鎖定技術  4.1 LogicLock技術的基本內(nèi)容    4.1.1 LogicLock技術解決系統(tǒng)設計優(yōu)化    4.1.2 LogicLock的基本內(nèi)容    4.1.3 鎖定區(qū)域的基本方式    4.1.4 層次化邏輯鎖定區(qū)域    4.1.5 LogicLock技術的不同應用流程    4.1.6 系統(tǒng)性能強化策略    4.1.7 鎖定區(qū)域的移植與再利用  4.2 流水線乘法器結(jié)構與未鎖定前特性  4.3 應用邏輯鎖定技術    4.3.1 pipemult模塊設計    4.3.2 確定邏輯鎖定區(qū)域及其特性    4.3.3 將設計實體移至鎖定區(qū)域    4.3.4 編譯優(yōu)化鎖定后的pipemult模塊    4.3.5 輸出邏輯鎖定約束信息    4.3.6 將VQM文件加入進頂層工程    4.3.7 輸入邏輯鎖定約束  【習題】  【實驗4-1】用邏輯鎖定優(yōu)化技術設計流水線乘法器實驗  【實驗4-2】用邏輯鎖定優(yōu)化技術設計16階數(shù)字濾波器實驗第5章 Matlab／DSP Builder設計向?qū)У?章 DSP與數(shù)字通信模塊設計第7章 SOPC設計初步第8章 Nios外設及其編程第9章 Nios軟件開發(fā)進階第10章 深入了解Nios系統(tǒng)設計第11章 Nios綜合設計示例第12章 自定制Nios指令附錄A SOPC／DSP實驗開發(fā)系統(tǒng)附錄B 實驗電路結(jié)構圖附錄C GW48 SOPC系統(tǒng)實驗信號名與芯片引腳對照表參考文獻

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