基于Quartus II的計(jì)算機(jī)組成與體系結(jié)構(gòu)綜合實(shí)驗(yàn)教程

內(nèi)容概要

　　《基于Quartus 2的計(jì)算機(jī)組成與體系結(jié)構(gòu)綜合實(shí)驗(yàn)教程》是針對(duì)計(jì)算機(jī)科學(xué)與技術(shù)專業(yè)的計(jì)算機(jī)組成與體系結(jié)構(gòu)綜合課程實(shí)驗(yàn)設(shè)計(jì)編寫的教材，突出了包括指令系統(tǒng)與CPU設(shè)計(jì)等在內(nèi)的計(jì)算機(jī)核心部件的設(shè)計(jì)方法，以及完整計(jì)算機(jī)從無(wú)到有的設(shè)計(jì)與實(shí)驗(yàn)。書中采用QuatrusII實(shí)例設(shè)計(jì)方法，方便實(shí)現(xiàn)。通過(guò)《基于Quartus 2的計(jì)算機(jī)組成與體系結(jié)構(gòu)綜合實(shí)驗(yàn)教程》學(xué)習(xí)，不僅能夠深入理解計(jì)算機(jī)組成與體系結(jié)構(gòu)，而且能夠掌握現(xiàn)代計(jì)算機(jī)硬件設(shè)計(jì)技術(shù)。

書籍目錄

前言第1章  緒論1.1  計(jì)算機(jī)系統(tǒng)的組成1.1.1  計(jì)算機(jī)硬件的組成1.1.2  計(jì)算機(jī)軟件的組成1.2  計(jì)算機(jī)系統(tǒng)的層次結(jié)構(gòu)1.2.1  計(jì)算機(jī)系統(tǒng)的多級(jí)層次結(jié)構(gòu)1.2.2  軟件與硬件的邏輯等價(jià)性1.3  計(jì)算機(jī)的工作過(guò)程第2章  Quartus Ⅱ 8.0基本使用方法2.1  概述2.2  Ouartus Ⅱ 8.0設(shè)計(jì)流程2.3  Quartus Ⅱ設(shè)計(jì)方法2.4  例解Quartus Ⅱ 8.0設(shè)計(jì)第3章  常用基本器件設(shè)計(jì)3.1  寄存器設(shè)計(jì)3.1.1  寄存器原理圖設(shè)計(jì)3.1.2  寄存器工作原理3.1.3  寄存器程序描述3.1.4  寄存器仿真3.2  移位運(yùn)算器設(shè)計(jì)3.2.1  移位運(yùn)算器原理圖設(shè)計(jì)3.2.2  移位運(yùn)算器程序描述3.2.3  移位運(yùn)算器仿真3.3  加減法運(yùn)算器設(shè)計(jì)3.3.1  加減法單元原理圖設(shè)計(jì)3.3.2  加減單元編碼3.3.3  多位加減法單元連接3.3.4  加減法運(yùn)算器原理圖設(shè)計(jì)3.3.5  加減法運(yùn)算器程序描述3.3.6  加減法運(yùn)算器仿真3.4  乘法運(yùn)算器設(shè)計(jì)3.4.1  乘法陣列原理圖設(shè)計(jì)3.4.2  乘法陣列編碼3.4.3  有符號(hào)數(shù)乘法運(yùn)算器3.5  同步計(jì)數(shù)器設(shè)計(jì)3.5.1  設(shè)備同步工作3.5.2  程序計(jì)數(shù)器3.5.3  通用計(jì)數(shù)器3.6  節(jié)拍器設(shè)計(jì)3.6.1  節(jié)拍器電路設(shè)計(jì)3.6.2  節(jié)拍器程序描述3.6.3  節(jié)拍器工作原理3.7  譯碼器設(shè)計(jì)3.7.1  譯碼器電路設(shè)計(jì)3.7.2  譯碼器程序描述3.7.3  選擇與通斷控制電路3.8  標(biāo)志線設(shè)計(jì)3.8.1  累加器標(biāo)志線設(shè)計(jì)3.8.2  數(shù)據(jù)監(jiān)測(cè)標(biāo)志設(shè)計(jì)3.9  存儲(chǔ)器設(shè)計(jì)3.9.1  地址譯碼器設(shè)計(jì)3.9.2  存儲(chǔ)單元設(shè)計(jì)3.9.3  256存儲(chǔ)單元存儲(chǔ)器設(shè)計(jì)第4章  計(jì)算機(jī)設(shè)計(jì)實(shí)例4.1  簡(jiǎn)單計(jì)算機(jī)實(shí)驗(yàn)4.1.1  設(shè)計(jì)8位累加器A4.1.2  設(shè)計(jì)8位數(shù)據(jù)寄存器B4.1.3  設(shè)計(jì)運(yùn)算器ALU4.1.4  設(shè)計(jì)8位輸出寄存器O4.1.5  設(shè)計(jì)4位地址寄存器MAR4.1.6  設(shè)計(jì)EROM4.1.7  設(shè)計(jì)8位指令寄存器IR4.1.8  設(shè)計(jì)4位程序計(jì)數(shù)器4.1.9  設(shè)計(jì)控制器CONT4.1.10  設(shè)計(jì)加減運(yùn)算計(jì)算機(jī)整機(jī)結(jié)構(gòu)4.1.11  功能仿真4.1.12  實(shí)驗(yàn)小結(jié)4.2  計(jì)算機(jī)整體設(shè)計(jì)4.2.1  計(jì)算機(jī)組成結(jié)構(gòu)4.2.2  計(jì)算機(jī)功能設(shè)計(jì)目標(biāo)4.2.3  確定指令系統(tǒng)4.3  總線結(jié)構(gòu)設(shè)計(jì)4.3.1  連接存儲(chǔ)器和運(yùn)算器4.3.2  累加器、計(jì)數(shù)器連人總線4.3.3  操作數(shù)寄存器、數(shù)據(jù)寄存器、輸出寄存器連入總線4.4  指令系統(tǒng)設(shè)計(jì)4.4.1  指令全程分析4.4.2  計(jì)算機(jī)指令全程表4.5  控制器設(shè)計(jì)4.5.1  控制器的基本功能和結(jié)構(gòu)4.5.2  時(shí)序控制信號(hào)4.5.3  微程序控制器4.5.4  硬聯(lián)控制器4.6  輸入接口設(shè)備設(shè)計(jì)4.6.1  緩沖區(qū)接口電路4.6.2  操作系統(tǒng)的設(shè)計(jì)4.7  計(jì)算機(jī)總體設(shè)計(jì)4.7.1  頂層結(jié)構(gòu)4.7.2  輸入程序數(shù)據(jù)控制4.8  程序運(yùn)行測(cè)試4.8.1  頂層文件與連接驅(qū)動(dòng)程序4.8.2  檢驗(yàn)程序執(zhí)行第5章  實(shí)訓(xùn)項(xiàng)目5.1  運(yùn)算器5.1.1  基本運(yùn)算器實(shí)驗(yàn)5.1.2  多通路運(yùn)算器與寄存器堆設(shè)計(jì)實(shí)驗(yàn)5.1.3  陣列乘法器設(shè)計(jì)實(shí)驗(yàn)5.2  存儲(chǔ)系統(tǒng)5.2.1  FIFO先進(jìn)先出存儲(chǔ)器實(shí)驗(yàn)5.2.2  Cache控制器設(shè)計(jì)實(shí)驗(yàn)一5.3  控制器5.3.1  時(shí)序發(fā)生器設(shè)計(jì)實(shí)驗(yàn)5.3.2  微程序控制器實(shí)驗(yàn)5.4  系統(tǒng)總線與總線接口5.4.1  系統(tǒng)總線和具有基本輸人、輸出功能的總線接口實(shí)驗(yàn)5.4.2  具有DMA控制功能的總線接口實(shí)驗(yàn)5.5  指令系統(tǒng)5.5.1  計(jì)算機(jī)系統(tǒng)的指令系統(tǒng)5.5.2  基于CISC技術(shù)的模型計(jì)算機(jī)設(shè)計(jì)實(shí)驗(yàn)5.5.3  基于RISC技術(shù)的模型計(jì)算機(jī)設(shè)計(jì)實(shí)驗(yàn)5.6  時(shí)間并行性為特征的計(jì)算機(jī)系統(tǒng)5.6.1  基于重疊技術(shù)的模型計(jì)算機(jī)設(shè)計(jì)實(shí)驗(yàn)5.6.2  具有三級(jí)流水的模型機(jī)設(shè)計(jì)實(shí)驗(yàn)5.7  指令并行性為特征的計(jì)算機(jī)系統(tǒng)參考文獻(xiàn)附錄  實(shí)驗(yàn)硬件平臺(tái)及軟件使用說(shuō)明附錄A  TD.cMA系統(tǒng)硬件環(huán)境A1  系統(tǒng)硬件布局圖A2  系統(tǒng)實(shí)驗(yàn)單元電路附錄B  軟件使用說(shuō)明B1  TD-CMA軟件界面窗口介紹B2  菜單功能介紹附錄C  實(shí)用芯片介紹

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